時鐘信號是時序邏輯的基礎,它用於決定邏輯單元中的狀態何時更新。時鐘信號是指有固定周期並與運行無關的信號量,時鐘頻率(clock frequency,CF)是時鐘周期的倒數。
時鐘邊沿觸發信號意味著所有的狀態變化都發生在時鐘邊沿到來時刻。
在邊沿觸發機制中,只有上升沿或下降沿才是有效信號,才能控制邏輯單元狀態量的改變。至於到底是上升沿還是下降沿作為有效觸發信號,則取決於邏輯設計的技術。
同步是時鐘控制系統中的主要制約條件。同步是指在有效信號沿發生時刻,希望寫入單元的數據也有效。數據有效則是指數據量比較穩定(不發生改變),並且只有當輸入發生變化時數值才會發生變化。由於組合電路無法實現反饋,所以只要輸入量不發生變化,輸出最後最終會是一個穩定有效的量。
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